在現代運算生態中，硬體指令集架構決定了軟體如何與處理器溝通。長期以來，市場由 x86 與 ARM 等專有架構主導，但 RISC-V 的崛起改變了這一局面。RISC-V 是一種開源的指令集架構（Instruction Set Architecture, ISA），它不像 x86 受限於特定商業實體的掌控，也不像 ARM 需要支付昂貴的授權費用。由於其規格完全公開且具備模組化特性，開發者與企業可以自由實作並根據需求自定義硬體，有效避免了供應商鎖定（Vendor Lock-in）的問題。隨著其生態系預計在 2032 年前大幅擴張，確保主流程式語言能在該平台上穩定運行，已成為軟體生態系統的重要目標。
根據 InfoQ 的報導，Python 的核心開發團隊近期宣布，CPython 正式將 RISC-V 列為 Tier 3 支援平台。CPython 是 Python 語言的官方參考實作，也是絕大多數開發者所使用的解釋器版本。而在 Python 的平台支援文件 PEP 11 中，將一個平台定義為 Tier 3，意味著該架構已進入官方支援範圍。雖然 Tier 3 平台在發生損壞時不會直接阻礙核心版本的發布，但這次將其納入官方上游支援，移除了過去將 RISC-V 整合進軟體持續整合與持續部署（CI/CD）流程中的重大障礙。
為了達成此里程碑，社群投入了大量的協作努力。開發者在真實的實體硬體上運行測試、修復架構特定的錯誤、強化建置基礎設施並提交相關補丁。在此過程中，RISE Project 提供了關鍵的硬體支援，捐贈了多台實體 RISC-V 機器作為 Buildbots（自動化建置機器人），讓開發團隊能針對特定架構的問題進行偵錯與驗證。目前，團隊正透過 RISE RISC-V Runners 計畫，嘗試將 RISC-V 硬體直接整合進 CPython 的持續整合（CI）管線中，以縮短開發者在提交程式碼後獲取自動化回饋的延遲時間。
從技術演進的角度來看，Tier 3 僅僅是起點。開發團隊的目標是將 RISC-V 提升至 Tier 2 支援，並深入研究針對該架構的特定優化。例如，利用 RV64GC 等硬體設定以及 RVA23 等新標準，探索如何運用向量擴展（Vector Extensions）、位元操作（Bit Manipulation）與無分支指令（Branchless Instructions）來提升 Python 解釋器的執行效能。這類優化能讓 Python 在 RISC-V 硬體上運行得更快速，充分發揮開源架構在硬體層級的靈活性。
然而，CPython 的支援僅代表了生態系中的單一層級。要讓 RISC-V 真正具備完整的實用性，仍需要第三方 Python 套件、編譯器、工具鏈以及開發者基礎設施的共同支持。目前開發團隊已公開呼籲擁有相容開發板的開發者參與測試，透過實際運行工作負載與測試套件來回饋潛在的崩潰或錯誤。這顯示出開源軟硬體協作的特性：官方提供基礎支援，而真正的穩定性則需要透過廣大的社群在多樣化的硬體環境中共同驗證。
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